Systemverilog uvm_config_dbについて考える
はじめに
UVMを使っていると必ず出てくるuvm_config_db。
なんとなく、テストベンチでInterfaceをデータベースに登録して、クラスの中で呼び出すんだなぁと漠然と思っていました。
今回は様々な条件で使用し...
プログラミング言語
Systemverilog Python Python ブロック図を生成するスクリプトを作成したい
はじめに
Pythonでブロック図を作成したいです。
とりあえず、ブロック２つで作ってみました。
サンプルコード
import matplotlib.pyplot as plt
import matplotlib....
Python Python Tkinter create_imageで画像が表示されないとき
はじめに
環境：Python 3.10.1
create_imageは、create_image(<水平中心位置>, <垂直中心位置>, image=<画像>)
でCanvasに任意の画像を表示するメソ...
Python Python Tkinter Canvas のサンプルコード
サンプルコード
create_arc：円弧
import tkinter
app = tkinter.Tk()
app.title("App Title")
arc = tkinter.Canv...
Python Python Tkinter 四角とテキストを描画する
サンプルコード
import tkinter
app = tkinter.Tk()
app.title("App Title")
canvas = tkinter.Canvas(
app,
wi...
Systemverilog UVM Sequenceを実行する方法まとめ
サンプルコード
sample_sequence_item.svh
Sequenceで使用するSequence_itemです。
class sample_sequence_item extends uvm_sequence...
Systemverilog UVM Virtual SequenceでSequenceを実行する方法まとめ
サンプルコード
sample_seq.svh（Sequence）
今回使用するSequenceです。
クラス変数として、din1とdin2を持ちます。
class sample_seq extends uvm_se...
Systemverilog 【UVM】ScoreBoardを作成する~期待値比較する~【#3】
はじめに
前回はuvm_tlm_analysis_fifoを使用してFIFOを実装しました。
今回はDUTの出力を取得してScoreBoardで期待値比較します。
サンプルコード
dut.sv
入力デ...
Systemverilog 【UVM】ScoreBoardを作成する~uvm_tlm_analysis_fifoを使用する~【#2】
はじめに
前回はScoreBoardでAnalysis Exportを定義してMonitor階層のAnalysis Portと接続しました。
Analysis Exportはデータを受け取るだけなので、FIFOのようにデータを...
Systemverilog 【UVM】ScoreBoardを作成する~Monitor階層からトランザクションを取得する~【#1】
はじめに
ScoreBoardはDUTの出力と期待値を比較する階層です。
UVMモデルのMonitorとAnalysis Portを介してDUTの出力を取得します。
サンプルコード
sample_score...